Concetpion d'un soc à base d'ip opencores (openrisc 1200 processeur)
Abderrazak Snoussi - Collection Omn.univ.europ.
100 pages, parution le 01/02/2018
Résumé
Cette plateforme intègre un ensemble d'IP cores de la communauté Opencores. Le fameux processeur OpenRISC 1200, le bus d'interconnexion WISHBONE, UART16550, ETHERNET, une mémoire on-chip et le module GPIO sont les modules de base qui constituent cette plateforme. La partie logicielle de cette dernière est constituée d'un système d'exploitation Linux embarqué qui a 'et'e port'e pour supporter l'architecture du processeur afin de faciliter le développement des applications. La chaine d'outils OpenRISC pour le développement logiciel a 'et'e utilisée dans ce projet pour cross-compiler et déboguer les applications d'eveloppées. Dans ce projet, la plateforme FPGA utilisée est la Spartan3E Starter Board de la famille Xilinx 'equipée d'une puce XC3S500E, c'est une carte `a faible cout, connue par sa grande flexibilité, dispose de ressources nécessaires pour la conception des applications embarquées.
Caractéristiques techniques
| PAPIER | |
| Éditeur(s) | Editions universitaires européennes |
| Auteur(s) | Abderrazak Snoussi |
| Collection | Omn.univ.europ. |
| Parution | 01/02/2018 |
| Nb. de pages | 100 |
| Format | 15.2 x 22.9 |
| Couverture | Broché |
| Poids | 160g |
| EAN13 | 9786202277389 |
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